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[學員作業]Verilog--雙向IO練習
by Andre, 2011-05-22 17:22, Views(2960)
Verilog 雙向IO練習
請參考附件圖案。
(1)
RWn==0時,
write data (8bits) to module
 
(2) 
RWn==1時,
read data from module
module feedback write 進去的值的反相
 
(3)
reset 後,read value為55H
 
(註)
1.需使用Verilog語言
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